通過條件
成  績 :60 分
  • Introducton_processor_design(20180227)
  • run_first_verilog_example
  • verilog2017_1(20200303)
  • verilog2017_2(20100315)
  • verilog2017_3(20110301)
  • verilog2017_3(20170413)
  • verilog2017_4(20090413)
  • MIPS_R2000_ppt
  • MIPS_simulator_SPIM_20210526
  • MIPSR2000_ChenChengEn
  • MIPSR2000_ChenKungEou
  • MIPSR2000_LinChiWha
  • MIPSR2000_WhuWenChing
  • 期末專題20210526
授課老師
張孟洲
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